Vacante

VLSI Design Engineer

EdgeQ Technologies Private Limited

Tiempo completo Home Office Worldwide

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Análisis Técnico de Tec Gurus

Vacante para diseñar y verificar circuitos integrados digitales, ASIC y SoC mediante RTL, Verilog y SystemVerilog. Incluye síntesis, simulación, análisis PPA y cierre de timing con herramientas EDA, en modalidad remota.

VerilogSystemVerilogDiseño RTLLógica digitalMetodologías ASIC y SoCSíntesis y simulaciónVerificación funcionalAnálisis de timingTecnología CMOSHerramientas EDA Synopsys Cadence Siemens EDA

Descripción

Empresa: EdgeQ Technologies Private Limited

Diseño, verificación y optimización de circuitos integrados digitales, ASIC y SoC con RTL, Verilog y SystemVerilog, 100% remoto desde Estados Unidos.

Experiencia requerida

2 a 8 años en VLSI Design o ingeniería de semiconductores

Responsabilidades

Diseñar circuitos digitales y módulos RTL para ASIC y SoC, escribir y optimizar código RTL, ejecutar síntesis y verificación funcional, analizar PPA, depurar fallos, soportar cierre de timing y participar en revisiones de diseño

Conocimientos técnicos

Verilog, SystemVerilog, diseño RTL, lógica digital, metodologías ASIC y SoC, síntesis, simulación, verificación, análisis de timing, tecnología CMOS, herramientas EDA Synopsys Cadence Siemens EDA

Habilidades

Colaboración con equipos de diseño físico, verificación e ingeniería de semiconductores, depuración de problemas de diseño, comunicación técnica y documentación de especificaciones

Experiencia

2 a 8 años en VLSI Design o ingeniería de semiconductores

Conocimientos

Habilidades

Colaboración con equipos de diseño físico, verificación e ingeniería de semiconductores, depuración de problemas de diseño, comunicación técnica y documentación de especificaciones